Speaker
Mr
Matthias Balzer
(KIT)
Description
Eine immer häufigere Anforderung an Datenerfassungssysteme ist eine Abtastrate im Sub-ns Bereich. Neben einer kontinuierlichen Datenwandlung stellen die Anlog-Speicher-Pipelines ICs eine interessante Alternative dar. Das Signal wird dabei mit einer hohen Rate analog in einem Kondensatorarray gespeichert und kann z. B. nach einem Trigger-Ergebnis mit einer niedrigeren Rate ausgelesen und digitalisiert werden. Das IPE entwickelt ein Rear Transition Module (RTM) basierend auf dem MicroTCA.4 Standard mit 16 analogen Eingangskanälen und einer Abtastrate bis zu 5 GHz und externem Trigger-Eingang. Als Anlog-Speicher IC wird der vom PSI entwickelten DRS 4 Chip verwendet. Die digitalisierten Daten werden über ein FPGA basierendes MTCA.4 Frontend-Modul ausgelesen.
Primary author
Mr
Matthias Balzer
(KIT)
Co-authors
Mr
Alexander Menshikov
(KIT)
Mr
Denis Tcherniakhovski
(KIT)
Dr
Matthias Kleifges
(KIT)
